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問題描述：Cadence:適合高速布線，要做大量信號(hào)完整性分析時(shí)非常適合使用。適合超多層板的設(shè)計(jì)、多層顏色顯示、強(qiáng)大的布線器。Cadence SPB將OrCAD原理圖設(shè)計(jì)工具、Allegro PCB工具和信號(hào)完整性分析工具等打包在一塊了。 Altium Designer:使用自由，可以單獨(dú)放置過孔、焊盤，且可以隨意編輯。能在焊盤和走線上顯示網(wǎng)絡(luò)名稱，更適合雙面板、元件密度較低的板的設(shè)計(jì)。相對(duì)來講，Altium Designer使用上學(xué)起來要容易，界面做的很好看，但對(duì)于復(fù)雜的高速多層板的設(shè)計(jì)，效率要低。 設(shè)計(jì)工具都可以實(shí)現(xiàn)規(guī)定的要求，關(guān)鍵還在于使用的人和使用的領(lǐng)域，需要有很好的電路理論知識(shí)和實(shí)踐經(jīng)驗(yàn)。當(dāng)然Cadence也可以用來設(shè)計(jì)簡單的電路板，Altium Designer也可以用來畫復(fù)雜的多層板，但是有時(shí)間效率的區(qū)別。

回答(1).修改原理圖，然后更新網(wǎng)表！

回答(2).Cadence 是一個(gè)大型的EDA 軟件，它幾乎可以完成電子設(shè)計(jì)的方方面面，包括ASIC 設(shè)計(jì)、FPGA 設(shè)計(jì)和PCB 板設(shè)計(jì)。Cadence 在仿真、電路圖設(shè)計(jì)、自動(dòng)布局布線、版圖設(shè)計(jì)及驗(yàn)證等方面有著絕對(duì)的優(yōu)勢。Cadence 包含的工具較多幾乎包括了EDA 設(shè)計(jì)的方方面面。下面主要介紹其產(chǎn)品線的范圍。

回答(3).正反面的線都是綠色沒關(guān)系，設(shè)置下頂層和底層的Etch層的顏色就好；至于高亮，是不是有DRC錯(cuò)誤，自己再檢查一下。

回答(4).在你的安裝文件夾里面，路徑為 X:\Cadence\SPB_16.6\share\pcb\pcb_lib\symbols

回答(5).可以的，在原理圖里面的preferences下面的Miscellaneous下面的 enable intertool Communication勾上就OK了，然后必須要原理圖和PCB一致且放在同一路徑下。

回答(6).cadence軟件原理圖后綴：dsn，pcb文件后綴：brd

回答(7).作圖方面的有cad、ps，3dmax等，編程方面有c語言、c++、vb、java等，硬件測試有cpu_z等。

回答(8).串?dāng)_的本質(zhì)，其實(shí)就是傳輸線之間的互容與互感。 1.在PCB設(shè)計(jì)中為了減少線間串?dāng)_，應(yīng)保證線間距足夠大，當(dāng)線中心間距不少于3倍線寬時(shí)，則可保持大部分電場不互相干擾，這就是3W規(guī)則。在實(shí)際的工程操作中，高速信號(hào)線一般很難調(diào)節(jié)其信號(hào)的上升時(shí)間，為了減少串?dāng)_，我們應(yīng)該盡量滿足3W原則。 2.高速信號(hào)線在滿足條件的情況下，加入端接匹配可以減小或消除反射，從而減小串?dāng)_。 3.對(duì)于微帶傳輸線和帶狀傳輸線，將走線高度限制在高于地線平面10mils（1 mils = 0.00254 cm）以內(nèi)；盡量減少環(huán)路的數(shù)量，避免產(chǎn)生人為的環(huán)路并盡量減小環(huán)路的面積，這樣就減少了輻射源和易感應(yīng)電路，從而有效地消除感性串?dāng)_。 4.在串?dāng)_較嚴(yán)重的兩條平行走線的信號(hào)線之間插入一條地線可以減小容性串?dāng)_,但是這根地線需要每隔1/4波長加一個(gè)過孔接到地層； 建議你看下串?dāng)_的文章，以上提及的幾個(gè)方面都有講述。