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問題描述：SCK:時(shí)鐘信號(hào) SS:從機(jī)選擇 MOSI:主機(jī)輸出/從機(jī)輸入 MIOS:主機(jī)輸入/從機(jī)輸出

回答(1).布局遠(yuǎn)離干擾源，走線盡量短，注意角度，敏感信號(hào)可以包地。

回答(2).I2C總線是低速高阻總線，在PCB布線時(shí)要注意抗干擾，并且盡可能縮短引線長度，同時(shí)注意設(shè)置上拉電阻。不需要差分線的方式。

回答(3).有自動(dòng)布局和手動(dòng)布局，自動(dòng)布局的命令是菜單Tools>>Auto Placement>>Auto Placer1.元件排列規(guī)則 1).在通常條件下,所有的元件均應(yīng)布置在印制電路的同一面上，只有在頂層元件過密時(shí)，才能將一些高度有限并且發(fā)熱量小的器件，如貼片電阻、貼片電容...

回答(4).PCB布線原則 1.連線精簡原則 連線要精簡，盡可能短，盡量少拐彎，力求線條簡單明了，特別是在高頻回路中，當(dāng)然為了達(dá)到阻抗匹配而需要進(jìn)行特殊延長的線就例外了，例如蛇行走線等。 2.安全載流原則 銅線的寬度應(yīng)以自己所能承載的電流為基礎(chǔ)進(jìn)行設(shè)計(jì)，銅線的載流能力取決于以下因素：線寬、線厚（銅鉑厚度）、允許溫升等，下表給出了銅導(dǎo)線的寬度和導(dǎo)線面積以及導(dǎo)電電流的關(guān)系（軍品標(biāo)準(zhǔn)），可以根據(jù)這個(gè)基本的關(guān)系對(duì)導(dǎo)線寬度進(jìn)行適當(dāng)?shù)目紤]。 3.電磁抗干擾原則 電磁抗干擾原則涉及的知識(shí)點(diǎn)比較多，例如銅膜線的拐彎處應(yīng)為圓角或斜角（因?yàn)楦哳l時(shí)直角或者尖角的拐彎會(huì)影響電氣性能）雙面板兩面的導(dǎo)線應(yīng)互相垂直、斜交或者彎曲走線，盡量避免平行走線，減小寄生耦合等。 一)通常一個(gè)電子系統(tǒng)中有各種不同的地線，如數(shù)字地、邏輯地、系統(tǒng)地、機(jī)殼地等，地線的設(shè)計(jì)原則如下： a.正確的單點(diǎn)和多點(diǎn)接地 在低頻電路中，信號(hào)的工作頻率小于1MHZ，它的布線和器件間的電感影響較小，而接地電路形成的環(huán)流對(duì)干擾影響較大，因而應(yīng)采用一點(diǎn)接地。當(dāng)信號(hào)工作頻率大于10MHZ時(shí)，如果采用一點(diǎn)接地，其地線的長度不應(yīng)超過波長的1/20，否則應(yīng)采用多點(diǎn)接地法。 b.數(shù)字地與模擬地分開 若線路板上既有邏輯電路又有線性電路，應(yīng)盡量使它們分開。一般數(shù)字電路的抗干擾能力比較強(qiáng)，例如TTL電路的噪聲容限為0.4~0.6V，CMOS電路的噪聲容限為電源電壓的0.3~0.45倍，而模擬電路只要有很小的噪聲就足以使其工作不正常，所以這兩類電路應(yīng)該分開布局布線。 c.接地線應(yīng)盡量加粗 若接地線用很細(xì)的線條，則接地電位會(huì)隨電流的變化而變化，使抗噪性能降低。因此應(yīng)將地線加粗，使它能通過三倍于印制板上的允許電流。如有可能，接地線應(yīng)在2~3mm以上。 d.接地線構(gòu)成閉環(huán)路 只由數(shù)字電路組成的印制板，其接地電路布成環(huán)路大多能提高抗噪聲能力。因?yàn)榄h(huán)形地線可以減小接地電阻，從而減小接地電位差。 二)配置退藕電容 PCB設(shè)計(jì)的常規(guī)做法之一是在印刷板的各個(gè)關(guān)鍵部位配置適當(dāng)?shù)耐伺弘娙�，退藕電容的一般配置原則是： a.電源的輸入端跨接10~100uf的電解電容器，如果印制電路板的位置允許，采用100uf以上的電解電容器抗干擾效果會(huì)更好。 b.原則上每個(gè)集成電路芯片都應(yīng)布置一個(gè)0.01uf~`0.1uf的瓷片電容，如遇印制板空隙不夠，可每4~8個(gè)芯片布置一個(gè)1~10uf的鉭電容（最好不用電解電容，電解電容是兩層薄膜卷起來的，這種卷起來的結(jié)構(gòu)在高頻時(shí)表現(xiàn)為電感，最好使用鉭電容或聚碳酸醞電容）。 c.對(duì)于抗噪能力弱、關(guān)斷時(shí)電源變化大的器件，如RAM、ROM存儲(chǔ)器件，應(yīng)在芯片的電源線和地線之間直接接入退藕電容。 d.電容引線不能太長，尤其是高頻旁路電容不能有引線。 三)過孔設(shè)計(jì) 在高速PCB設(shè)計(jì)中，看似簡單的過孔也往往會(huì)給電路的設(shè)計(jì)帶來很大的負(fù)面效應(yīng)，為了減小過孔的寄生效應(yīng)帶來的不利影響，在設(shè)計(jì)中可以盡量做到： a.從成本和信號(hào)質(zhì)量兩方面來考慮，選擇合理尺寸的過孔大小。例如對(duì)6- 10層的內(nèi)存模塊PCB設(shè)計(jì)來說，選用10/20mil（鉆孔/焊盤）的過孔較好，對(duì)于一些高密度的小尺寸的板子，也可以嘗試使用8/18Mil的過孔。在目前技術(shù)條件下，很難使用更小尺寸的過孔了（當(dāng)孔的深度超過鉆孔直徑的6倍時(shí)，就無法保證孔壁能均勻鍍銅）；對(duì)于電源或地線的過孔則可以考慮使用較大尺寸，以減小阻抗。 b.使用較薄的PCB板有利于減小過孔的兩種寄生參數(shù)。 c.PCB板上的信號(hào)走線盡量不換層，即盡量不要使用不必要的過孔。 d.電源和地的管腳要就近打過......

回答(5).沒必要，數(shù)據(jù)傳輸速率不高，而且信號(hào)幅度大，不易受到干擾，高低電平的容限大，就算有些小噪聲引入，也做不了數(shù)據(jù)判定，如RS232電平TXD RXD 在-3V~-15V和+3V~+15V,在-3V~+3V之間的電平噪聲不作為數(shù)據(jù)采納處理，TTL電平同理L：<0.4V H：>2.4V 而0.4V~2.4V不作為數(shù)據(jù)可靠判定。而差分不一樣，信號(hào)頻率高 幅度小，稍微干擾或者噪聲就容易造成數(shù)據(jù)誤判斷。

回答(6).SPI：高速同步串行口 　　SPI：高速同步串行口。是一種標(biāo)準(zhǔn)的四線同步雙向串行總線。 　　SPI，是英語Serial Peripheral interface的縮寫，顧名思義就是串行外圍設(shè)備接口。是Motorola首先在其MC68HCXX系列處理器上定義的。SPI接口主要應(yīng)用在 EEPROM，F(xiàn)LASH，實(shí)時(shí)時(shí)鐘，AD轉(zhuǎn)換器，還有數(shù)字信號(hào)處理器和數(shù)字信號(hào)解碼器之間。SPI，是一種高速的，全雙工，同步的通信總線，并且在芯片的管腳上只占用四根線，節(jié)約了芯片的管腳，同時(shí)為PCB的布局上節(jié)省空間，提供方便，正是出于這種簡單易用的特性，現(xiàn)在越來越多的芯片集成了這種通信協(xié)議，比如AT91RM9200. 　　SPI總線系統(tǒng)是一種同步串行外設(shè)接口，它可以使MCU與各種外圍設(shè)備以串行方式進(jìn)行通信以交換信息。外圍設(shè)置FLASHRAM、網(wǎng)絡(luò)控制器、LCD顯示驅(qū)動(dòng)器、A/D轉(zhuǎn)換器和MCU等。SPI總線系統(tǒng)可直接與各個(gè)廠家生產(chǎn)的多種標(biāo)準(zhǔn)外圍器件直接接口，該接口一般使用4條線：串行時(shí)鐘線（SCLK）、主機(jī)輸入/從機(jī)輸出數(shù)據(jù)線MISO、主機(jī)輸出/從機(jī)輸入數(shù)據(jù)線MOSI和低電平有效的從機(jī)選擇線SS(有的SPI接口芯片帶有中斷信號(hào)線INT、有的SPI接口芯片沒有主機(jī)輸出/從機(jī)輸入數(shù)據(jù)線MOSI)。 　　SPI的通信原理很簡單，它以主從方式工作，這種模式通常有一個(gè)主設(shè)備和一個(gè)或多個(gè)從設(shè)備，需要至少4根線，事實(shí)上3根也可以（用于單向傳輸時(shí)，也就是半雙工方式）。也是所有基于SPI的設(shè)備共有的，它們是SDI（數(shù)據(jù)輸入），SDO（數(shù)據(jù)輸出），SCLK（時(shí)鐘），CS（片選）。 　�。�1）MOSI – SPI 總線主機(jī)輸出/ 從機(jī)輸入（SPI Bus Master Output/Slave Input） 　�。�2）MISO – SPI 總線主機(jī)輸入/ 從機(jī)輸出（SPI Bus Master Input/Slave Output) 　�。�3）SCLK – 時(shí)鐘信號(hào)，由主設(shè)備產(chǎn)生 　�。�4）CS – 從設(shè)備使能信號(hào)，由主設(shè)備控制(Chip select),有的IC此pin腳叫SS 　　其中CS是控制芯片是否被選中的，也就是說只有片選信號(hào)為預(yù)先規(guī)定的使能信號(hào)時(shí)（高電位或低電位），對(duì)此芯片的操作才有效。這就允許在同一總線上連接多個(gè)SPI設(shè)備成為可能。 　　接下來就負(fù)責(zé)通訊的3根線了。通訊是通過數(shù)據(jù)交換完成的，這里先要知道SPI是串行通訊協(xié)議，也就是說數(shù)據(jù)是一位一位的傳輸?shù)�。這就是SCLK時(shí)鐘線存在的原因，由SCK提供時(shí)鐘脈沖，SDI，SDO則基于此脈沖完成數(shù)據(jù)傳輸。數(shù)據(jù)輸出通過 SDO線，數(shù)據(jù)在時(shí)鐘上升沿或下降沿時(shí)改變，在緊接著的下降沿或上升沿被讀取。完成一位數(shù)據(jù)傳輸，輸入也使用同樣原理。這樣，在至少8次時(shí)鐘信號(hào)的改變（上沿和下沿為一次），就可以完成8位數(shù)據(jù)的傳輸。 　　要注意的是，SCLK信號(hào)線只由主設(shè)備控制，從設(shè)備不能控制信號(hào)線。同樣，在一個(gè)基于SPI的設(shè)備中，至少有一個(gè)主控設(shè)備。這樣傳輸?shù)奶攸c(diǎn)：這樣的傳輸方式有一個(gè)優(yōu)點(diǎn)，與普通的串行通訊不同，普通的串行通訊一次連續(xù)傳送至少8位數(shù)據(jù)，而SPI允許數(shù)據(jù)一位一位的傳送，甚至允許暫停，因?yàn)镾CLK時(shí)鐘線由主控設(shè)備控制，當(dāng)沒有時(shí)鐘跳變時(shí)，從設(shè)備不采集或傳送數(shù)據(jù)。也就是說，主設(shè)備通過對(duì)SCLK時(shí)鐘線的控制可以完成對(duì)通訊的控制。SPI還是一個(gè)數(shù)據(jù)交換協(xié)議：因?yàn)镾PI的數(shù)據(jù)輸入和輸出線獨(dú)立，所以允許同時(shí)完成數(shù)據(jù)的輸入和輸出。不同的SPI設(shè)備的實(shí)現(xiàn)方式不盡相同，主要是數(shù)據(jù)改變和采集的時(shí)間不同，在時(shí)鐘......

回答(7).調(diào)試口而已，最基本的布線就行

回答(8).智能手環(huán)PCB布局/布線注意事項(xiàng)： 1、PCB各部分電路分區(qū)布局，注意走線保護(hù) 在電路模塊布局時(shí)，一方面需要注意時(shí)鐘電路和晶振電路要經(jīng)過最短的路徑到達(dá)目標(biāo)管教，另一方面，在時(shí)鐘走線時(shí)還要注意避讓數(shù)據(jù)線，防止干擾影響系統(tǒng)的穩(wěn)定。 在走線時(shí)，需要對(duì)關(guān)鍵走線進(jìn)行保護(hù)。 2、PCB設(shè)計(jì)中處理好射頻電路 3、做好ESD防護(hù)設(shè)計(jì) 4、預(yù)留系統(tǒng)升級(jí)接口