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回答(1).可以對(duì)電子設(shè)備的幅頻特性進(jìn)行分析，可以對(duì)有線、無(wú)線電頻譜進(jìn)行分析。 該儀器應(yīng)用范圍較廣，可以監(jiān)視空間的無(wú)線電波，可以監(jiān)視被測(cè)設(shè)備的頻率發(fā)射范圍，分析不需要的頻率分布。 通訊可以監(jiān)控各種電臺(tái)輻射。 EMI可以分析各個(gè)頻率的干擾。 音頻可以分析失真（一般使用失真度分析儀）。

回答(2).因?yàn)轭l譜分析儀是一種窄帶掃頻接收機(jī)，它在某一時(shí)刻僅接收某個(gè)頻率范圍內(nèi)的能量。 而靜電放電等瞬態(tài)干擾是一種脈沖干擾，其頻譜范圍很寬，但時(shí)間很短，這樣頻譜分析儀在瞬態(tài)干擾發(fā)生時(shí)觀察到的僅是其總能量的一小部分，不能反映實(shí)際的干擾情況。

回答(3).直接測(cè)無(wú)線的話，比較容易被干擾，信號(hào)跳動(dòng)也比較大。先找個(gè)地方，2.4G信號(hào)干凈點(diǎn)的地方，然后再頻譜儀上接跟2.4G天線打開(kāi)峰值保持（MAX HOLD），實(shí)測(cè)一下無(wú)線是否干凈，如果沒(méi)有干擾信號(hào)，然后打開(kāi)你的無(wú)線AP就可以了，頻譜儀設(shè)置的話你要實(shí)際去調(diào)測(cè)了，沒(méi)測(cè)過(guò)，參數(shù)設(shè)置不好說(shuō)。 查看更多答案>>

回答(4).PCB設(shè)計(jì)中EMC設(shè)計(jì)如何避免受電磁干擾 電磁兼容性EMC（Electro Magnetic Compatibility），是指設(shè)備或系統(tǒng)在其電磁環(huán)境中符合要求運(yùn)行并不對(duì)其環(huán)境中的任何設(shè)備產(chǎn)生無(wú)法忍受的電磁干擾的能力。設(shè)計(jì)電路板時(shí)，一方面要盡可能的減少電磁頻譜的發(fā)射，另一方面則要保護(hù)本設(shè)備免受電磁干擾。電磁干擾源、耦合路徑和接收器，是形成干擾的三個(gè)要素，缺少其中任何一個(gè)都不會(huì)形成干擾。 電磁兼容性設(shè)計(jì)與具體電路有著密切的關(guān)系，為了進(jìn)行電磁兼容性設(shè)計(jì)，設(shè)計(jì)者需要將輻射（從產(chǎn)品中泄漏的射頻能量）減到最小，并增強(qiáng)其對(duì)輻射（進(jìn)入產(chǎn)品中的能量）的易感性和抗干擾能力。而對(duì)于低頻時(shí)常見(jiàn)的傳導(dǎo)耦合，高頻時(shí)常見(jiàn)的輻射耦合，切斷其耦合途徑是在設(shè)計(jì)時(shí)務(wù)必應(yīng)該給予充分重視的。龍芯科技【】根據(jù)多年的經(jīng)驗(yàn)累積，認(rèn)為抗干擾設(shè)計(jì)的基本原則有三個(gè)：抑制干擾源，切斷干擾傳播路徑，提高敏感器件的抗干擾性能。 1. 抑制干擾源 抑制干擾源就是盡可能的減小干擾源的du/dt（數(shù)字器件電壓變化率），di/dt（數(shù)字器件電流變化率）。這是抗干擾設(shè)計(jì)中最優(yōu)先考慮和最重要的原則，常常會(huì)起到事半功倍的效果。減小干擾源的du/dt主要是通過(guò)在干擾源兩端并聯(lián)電容來(lái)實(shí)現(xiàn)。減小干擾源的di/dt則是在干擾源回路串聯(lián)電感或電阻以及增加續(xù)流二極管來(lái)實(shí)現(xiàn)。 2. 切斷干擾傳播路徑 （1）充分考慮電源對(duì)單片機(jī)的影響。電源做得好，整個(gè)電路的抗干擾就解決了一大半。許多單片機(jī)對(duì)電源噪聲很敏感，要給單片機(jī)電源加濾波電路或穩(wěn)壓器，以減小電源噪聲對(duì)單片機(jī)的干擾。 （2）注意晶振布線。晶振與單片機(jī)引腳盡量靠近，用地線把時(shí)鐘區(qū)隔離起來(lái)，晶振外殼接地并固定。 （3）電路板合理分區(qū)，如強(qiáng)、弱信號(hào)，數(shù)字、模擬信號(hào)。盡可能把干擾源（如電機(jī)，繼電器）與敏感元件（如單片機(jī)）遠(yuǎn)離。 （4）用地線把數(shù)字區(qū)與模擬區(qū)隔離，數(shù)字地與模擬地要分離，最后在一點(diǎn)接于電源地。A/D、D/A芯片布線也以此為原則。 3. 提高敏感器件的抗干擾性能 提高敏感器件的抗干擾性能是指從敏感器件這邊考慮盡量減少對(duì)干擾噪聲的拾取，以及從不正常狀態(tài)盡快恢復(fù)的方法。提高敏感器件抗干擾性能的常用措施： （1）對(duì)于單片機(jī)閑置的I/O口，不要懸空，要接地或接電源。其它IC的閑置端在不改變系統(tǒng)邏輯的情況下接地或接電源。 （2）對(duì)單片機(jī)使用電源監(jiān)控電路，可大幅度提高整個(gè)電路的抗干擾性能。 （3）在速度能滿足要求的前提下，盡量降低單片機(jī)的晶振頻率和選用低速數(shù)字電路。 （4）IC器件盡量直接焊在電路板上，少用IC座。

回答(5).首先四層板的抗干擾效果肯定更好。主要是看什么樣的板子，如果兩層板也能夠保證一個(gè)完整的地，就是低阻抗回路，那么對(duì)于靜電脈沖群等干擾就已經(jīng)很不錯(cuò)了，例如完整的地在100Mhz時(shí)有3.7毫歐的阻抗，即使有100A的瞬態(tài)電流也只有0.37伏的壓降，就是相當(dāng)?shù)目垢蓴_了，但是假如不是完整的地，存在1cm的裂縫，那么將有20V的壓降，是非常危險(xiǎn)的。本人是做消防電子產(chǎn)品的，基本上都是2層板，工業(yè)3級(jí)抗干擾程度。

回答(6).印制電路板設(shè)計(jì)和布線時(shí)需要注意的問(wèn)題 | | 2010年04月20日 | [字體：小 大] | 點(diǎn)擊推薦給好友 關(guān)鍵詞： 印制板設(shè)計(jì)時(shí)，要考慮到干擾對(duì)系統(tǒng)的干擾，將電路的模擬部分和數(shù)字部分的電路嚴(yán)格分開(kāi)，對(duì)核心電路重點(diǎn)防護(hù)，將系統(tǒng)地線環(huán)繞，并布線盡可能粗，電源增加濾波電路，采用DC-DC隔離，信號(hào)采用光電隔離，設(shè)計(jì)隔離電源，分析容易產(chǎn)生干擾的部分（如時(shí)鐘電路、通訊電路等）和容易被干擾的部分（如模擬采樣電路等），對(duì)這兩種類(lèi)型的電路分別采取方法。對(duì)于干擾元件采取抑制方法，對(duì)敏感元件采取隔離和保護(hù)方法，并且將它們?cè)诳臻g和電氣上拉開(kāi)距離。在板級(jí)設(shè)計(jì)時(shí)，還要注意元器件放置要遠(yuǎn)離印制板邊沿，這對(duì)防護(hù)空氣放電是有利的。采樣電路的原理圖設(shè)計(jì)參見(jiàn)圖1： 圖1：采樣電路設(shè)計(jì)。 電路的合理布局可以降低干擾，提高EMC性能。按照電路的功能劃分若干個(gè)功能模塊，分析每個(gè)模塊的干擾源和敏感信號(hào)，以便進(jìn)行特殊處理。印制板布線時(shí)，需要注意以下幾個(gè)方面：1、保持環(huán)路面積最小，例如電源和地之間形成的環(huán)路，減小環(huán)路面積，將減小電磁干擾在此回路上的感應(yīng)電流，電源線盡可能靠近地線，以減小差模輻射的環(huán)面積，降低干擾對(duì)系統(tǒng)的干擾，提高系統(tǒng)的抗干擾性能。并聯(lián)的導(dǎo)線緊緊放在一起，使用一條粗導(dǎo)線進(jìn)行連接，信號(hào)線緊挨地平面布線可以降低干擾。電源和地之間增加高頻濾波電容。2、使導(dǎo)線長(zhǎng)度盡可能的縮短，減小了印制板的面積，降低導(dǎo)線上的干擾。3、采用完整的地平面設(shè)計(jì)，采用幾層板設(shè)計(jì)，鋪設(shè)地層，便于干擾信號(hào)泄放。4、使電子元件遠(yuǎn)離可能會(huì)發(fā)生放電的平面如機(jī)箱面板、把手、螺釘?shù)�，保持機(jī)殼和地良好接觸，為干擾提供良好的泄放通道。對(duì)敏感信號(hào)包地處理，降低干擾。5、盡量采用貼片元器件，貼片器件比直插器件的EMC性能要好得多。6、模擬地和數(shù)字地在PCB和外界連接處進(jìn)行一點(diǎn)接地。7、高速邏輯電路應(yīng)靠近連接器邊緣，低速邏輯電路和存儲(chǔ)器則應(yīng)布置在遠(yuǎn)離連接器處，中速邏輯電路則布置在高速邏輯電路和低速邏輯電路之間。8、電路板上的印制線寬度不要突變，拐角應(yīng)采用圓弧形，不要直角或尖角。9、時(shí)鐘線、信號(hào)線也盡可能靠近地線，并且走線不要過(guò)長(zhǎng)，以減小回路的環(huán)面積。 本文鏈接：